求大神们给小弟一个数字信号八路抢答器器设计的毕业论文

本设计使用VHDL语言设计一个八路数字抢答器系统。VHDL是一种全方位的硬件描述..
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毕业设计(论文)-基于VHDL语言的八路数字抢答器系统的设计
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3秒自动关闭窗口随着科学技术的发展和普及,各种各样的竞赛越来越多,其中抢答器的作用也就显而易..
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3秒自动关闭窗口求大神设计一个八路抢答器_百度知道
求大神设计一个八路抢答器
抢答器现在普遍应用在各种竞赛和文体娱乐活动中,使用抢答器可以使判断公正、准确、直观。设计抢答电路,对8个输入进行仲裁,判断最先产生抢答信号的输入,并显示该输入端口号。具体要求如下:1. 主持人发出抢答指令之后,选手才可以进行抢答。没发出抢答指令之前,抢答器不会响应选手的操作。2. 抢答器挑选出第一个抢答的选手,完成挑选之后,抢答器将不再响应选手的操作。3. 抢答器拥有清零功能,清零之后,便可以开始下一次抢答。抢答电路对应的具体流程:1. 置使能端,电路复位。2. 判断使能信号是否有效,若有效,则开始仲裁各个输入信号,若无效,则不对各个信号进行仲裁。3. 使能信号有效的情况下,开始对输入信号进行仲裁,输出3bit代表最先被置位的信号端口值,并将使能信号无效,停止仲裁。4. 当清零信号有效时,输出复位,开始下一轮抢答,跳转到步骤2,等待使能信号。抢答电路实现:实现以上描述的抢答电路,要求输入8位抢答信号,1位使能信号,1位清零信号;输出3 bit,代表抢答成功的端口值 尤其是对此的verilog语言的仿真怎么写!!
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