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ADSP-21469:
第四代高性能DSP
包括ADSP-21469在内的第四代SHARC(R)处理器可提供改进的性能、基于硬件的滤波器加速器、面向音频与应用的外设，以及能够支持最新环绕声解码器算法的新型存储器配置。所有器件都彼此引脚兼容，而且与以往的所有SHARC处理器代码完全兼容。这些最新的SHARC处理器系列产品都基于单指令多数据（SIMD）内核，内核支持32
bit定点以及32/40 bit浮点算法格式，这使得这些处理器特别适合于高性能音频应用。
在第四代SHARC处理器系列产品中具有450 MHz/2700
MFLOP的最高性能，这使得ADSP-21469特别适合于满足专业音频与汽车音响市场领域不断增长的需求。除了更高的内核性能外，ADSP-21469还包括其它处理模块，如FIR、IIR与FFT加速器，以提高系统的整体性能。被称作可变指令集架构（VISA）的新特性可使代码规模缩小20%～30%，并提高存储器容量可用性。第四代DSP提供到16
bit DDR2 SDRAM的无缝接口，能够连接到更快的外部存储器。第四代SHARC处理器还集成了专用外设，以简化硬件设计、减小设计风险，并最终缩短上市时间。组合在一起的功能模块被称作数字应用接口（DAI），这些功能模块可以互相连接，或通过可以由软件编程的信号路由单元（SRU）引出外部引脚。SRU是创新的架构特性，能够在DAI模块之间实现完整且灵活的路由。通过SRU连接的外设包括但不限于串行端口、SPI端口、S/PDIF
Tx/Rx，以及八通道异步采样速率转换器模块。第四代SHARC处理器使数据可通过DMA控制器从串行端口直接传输至外部存储器。UART与2线接口等其它外设则通过数字外设接口（DPI）进行中继。
The fourth generation of SHARC(R) Processors, which includes the ADSP-21469,
offers increased performance, hardware-based filter accelerators, audio and
application-focused peripherals, and new memory configurations capable of
supporting the latest surround-sound decoder algorithms. All devices are
pin-compatible with each other and completely code-compatible with all prior
SHARC Processors. These newest members of the SHARC Processor family are based
on a single-instruction, multiple-data (SIMD) core, which supports both 32-bit
fixed-point and 32-/40-bit floating-point arithmetic formats making them
particularly suitable for high-performance audio applications.
The ADSP-21469 offers the highest performance – 450 MHz/2700 MFLOPs -- within
the fourth generation SHARC Processor family. This level of performance makes
the ADSP-21469 particularly well suited to address the increasing requirements
of the professional and automotive audio market segments. In addition to its
higher core performance, the ADSP-21469 includes additional processing blocks
such as FIR, IIR, and FFT accelerators to increase the total performance of the
system. There is a new feature called Variable Instruction Set Architecture
(VISA) that allows the code size to be decreased by 20% to 30% and increase the
memory size availability. The fourth generation DSP allows the ability to
connect to faster external memory by providing a glueless interface to 16-bit
wide DDR2 SDRAMs.
Fourth-generation SHARC Processors also integrate application-specific
peripherals designed to simplify hardware design, minimize design risks, and
ultimately reduce time to market. Grouped together, and broadly named the
Digital Applications Interface (DAI), these functional blocks may be connected
to each other or to external pins via the software-programmable Signal Routing
Unit (SRU). The SRU is an innovative architectural feature that enables complete
and flexible routing amongst DAI blocks. Peripherals connected through the SRU
include but are not limited to serial ports, SPI ports, S/PDIF Tx/Rx, and an
8-Channel asynchronous sample rate converter block. The fourth generation SHARC
allows data from the serial ports to be directly transferred to external memory
by the DMA controller. Other peripherals such as UART and Two-Wire Interface are
routed through a Digital Peripheral Interface (DPI).
内核时钟速率：450 MHz
片上RAM：5 Mb
FIR、IIR与FFT加速器
16-bit DDR2外部存储器接口
数字应用接口(DAI)支持用户定义的外设访问，包括S/P DIF Tx/Rx，以及八通道异步采样率转换器。
全面增强的DMA引擎，包括分散/收集DMA、延迟线DMA
2个链接端口
8个串行端口（SPORT），支持I2S、左对齐采样对，以及TDM模式
2个SPI兼容端口，支持主、从模式
UART与2线接口
16个脉冲宽度调制（PWM）通道
3个全功能定时器
324引脚PBGA封装
商用和工业温度范
Clock Speed (MHz): 450MHz
MMACs: 900
On-Chip SRAM (Mbits): 5Mbit
Serial Ports: 8
Link Ports: 2
Package: PBGA
Sample Rate Converters: Yes
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ADSP-21469
应用技术支持与电子电路设计开发资源下载ADSP-21469的SRC问题 - OpenADSP社区论坛
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-> &->&ADSP-21469的SRC问题本帖共有171个阅读者
ADSP-21469的SRC问题
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小大 楼主 |
ADSP-21469的SRC问题问： 本人新手一枚，在实现21469例程里面&&&&&&&&Power_On_Self_Test的analog_audio_test模块时，使用I2S传输模式对产生的sin信号进行DAC转换从耳机输出，程序正确。在此基础上增加SRC采样速率转换模块。耳机有声音出来，但是声音不对，希望各位能够帮忙解决问题，谢谢！！我是OP...
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小大 第 1 楼 |
答：1）我建议你先把PCG的代码拿掉，SRC的输入和输出的sclk, fs,SPORT0 的SCLK，FS信号都使用SPORT1的SCLK，FS信号，你看看是否可以听到正确的声音 2）你用PCG的产生SCLK, FS 信号，你用示波器量一下，这2个信号是否正确 3）如果2正确了，你把PCG的信号输入给SPORT0,把SRC的代码拿掉，直接跑sport loopback，你看看是否有正确的声音我是OP...
OpenADSP(管理员)
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小大 第 2 楼 |
问：非常感谢你的回答，我在最开始贴的程序确实是错误的，在 Power_On_Self_Test的analog_audio_test模块里面数据是在DAC运行时才被写进去的，所以我的SRC加入的位置不对，我进行了重新修改后，SRU的配置程序如下:void Init_DAI_I2S(){&&&&Clear_DAI_Pins();;&& &&&&SRU(PCG_CLKA_O, SRC0_CLK_IP_I);&&&&SRU(PCG_FSA_O, SRC0_FS_IP_I);&&&&SRU(PCG_CLKA_O, SPORT0_CLK_I);&&&&SRU(PCG_FSA_O, SPORT0_FS_I);&&&&SRU(SPORT0_DA_O, SRC0_DAT_IP_I);&&
&&&&SRU(DAI_PB07_O, SRC0_CLK_OP_I);&&&&SRU(DAI_PB08_O, SRC0_FS_OP_I);&&
&&&&SRU(HIGH, PBEN12_I);&&&&SRU(SRC0_DAT_OP_O, DAI_PB12_I);&&&&// DAIP12 (DSDATA1) to SPORT0 DA (TX)&&
//--------------------------------------------------------------------------// Route SPI signals to AD1939 Control Port.
&&&&SRU(SPI_MOSI_O, DPI_PB01_I);&&&& //Connect MOSI to DPI PB1.&&&&SRU(DPI_PB02_O, SPI_MISO_I);&&&& //Connect DPI PB2 to MISO.&&&&SRU(SPI_CLK_O, DPI_PB03_I);&&&&&&//Connect SPI CLK to DPI PB3.&&&&SRU(SPI_FLG0_O, DPI_PB04_I);&&&& //Connect SPI FLAG0 to DPI PB4.&& && //---------------------------------------------------------------------------// Tie pin buffer enable from SPI peripheral to determine whether they are// inputs or outputs
&&&&SRU(SPI_MOSI_PBEN_O, DPI_PBEN01_I);&&&&SRU(SPI_MISO_PBEN_O, DPI_PBEN02_I);&&&&SRU(SPI_CLK_PBEN_O, DPI_PBEN03_I);&&&&SRU(SPI_FLG0_PBEN_O, DPI_PBEN04_I);&&} ======================================PCG的设置为：
#define CLKIN&&&&&&&&&&&&&&&&&&&& #define SRC0_SAMPLE_RATE&&&&&&&&&&192000#define BCLK_SRC0&&&&&&&&&&&&&&&& (64 * SRC0_SAMPLE_RATE)#define CLKA_DIVIDER (CLKIN/BCLK_SRC0)#define FSA_DIVIDER&&(CLKIN/SRC0_SAMPLE_RATE)#define PHASE_SHIFTA (((CLKA_DIVIDER)/2+1)&&20)void InitPCG(){&&&&&&&&&&*pPCG_CTLA1=CLKA_DIVIDER | PHASE_SHIFTA;&&&&&&&&&&*pPCG_CTLA0=FSA_DIVIDER | ENFSA | ENCLKA; &&&&&&&&&&*pPCG_PW=0;&&&&&&&&&&*pPCG_SYNC=0;}sine513是频率为1hz的正弦波，产生如下波形：现在耳机可以听到声音且感觉没有杂音，但是从输出的波形看我怀疑输入信号是否有进入到SRC模块中，因为听到的声音和直接进行DAC转换时设置不同采样率的结果一样？例外SRU配置SRC的输出FS和CLK的时候使用的是DAI_PB07，DAI_PB08的输出，但是因为没有ADC的话，这两个应该没有任何连接，但是设置成别的声音有不对，还请麻烦您帮忙指导一下该怎么解决这个问题 例外，因为条件限制所以没有示波器，请问一下还有别的方法可以查看PCG的产生信号吗? 非常期待你的指导和回答，谢谢！！！我是OP...
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小大 第 3 楼 |
答：1）我的建议是你先把PCG相关的代码拿掉2)&&你的系统的SRU设计有问题，你可以这样配置，所有的SPORT，SRC，以及DAC的FS ，CLK，都共用ADC产生的FS，CLK&& 1. Connect ADC to SPORT0&&&&2. Connect SPORT1 to SRC1-INPUT&&&&3. Connect SRC1-OUTPUT to SPORT2&&&&4. Connect SPORT3&4 to DAC's3）你的系统里面需要把SPORT1 ，SPORT3, SPORT4配置成TX，SPORT0,SPORT2配置成RX4）你需要把数据从SPORT0 RXBUF 拷贝到SPORT 1 TXBUF，从SPORT2 的RX BUF 拷贝到SPORT3&4 TXBuf5)&&关于上面的配置，你可以参看C:\Analog Devices\VisualDSP 5.0\214xx\Examples\ADSP-21469 EZ-Board\SPDIF to Analog TalkThru with SRC (C)6）等你的SRC+SPORT的loopback跑起来了，再考虑把PCG加进来我是OP...
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小大 第 4 楼 |
问： 我在系统中把SPORT2，SPORT3和SPORT4这些内容全部去掉了，现在的程序只是--&SPORT0---&SRC0---&DAC(1939)的方式，信号是内存中sine4000的.dat文件产生的，SPORT0和SRC0的输入时钟和帧同步是PCG产生的，SRC0的CLK_OP_I和FS_OP_I由DAI_PB06_O和DAI_PB07_O提供，耳机里听到的声音正确，但是我不知道是否有经过SRC的模块，因为听到的声音和不加入SRC仅仅把1939的采样率改为192的声音是一样的我是OP...
OpenADSP(管理员)
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小大 第 5 楼 |
答：你要确认你的PCG的代码是否正确工作。用示波器看PCG产生的信号比较直观。下面的PCG的代码可以给你参考#define CLKIN #define TX_SAMPLE_RATE 48000#define RX_SAMPLE_RATE 96000#define BCLK_TX&&(64 * TX_SAMPLE_RATE)#define BCLK_RX&&(64 * RX_SAMPLE_RATE)#define CLKA_DIVIDER (CLKIN/(BCLK_TX))#define CLKB_DIVIDER (CLKIN/(BCLK_RX))#define FSA_DIVIDER (CLKIN / TX_SAMPLE_RATE)#define FSB_DIVIDER (CLKIN / RX_SAMPLE_RATE)#define PHASE_SHIFTA (((CLKA_DIVIDER)/2 + 1) && 20)#define PHASE_SHIFTB (((CLKB_DIVIDER)/2 + 1) && 20) *pPCG_CTLA1 = CLKA_DIVIDER | PHASE_SHIFTA;&&&&// 48KHz*pPCG_CTLA0 =&&FSA_DIVIDER | ENFSA | ENCLKA ;&&*pPCG_CTLB1 = CLKB_DIVIDER | PHASE_SHIFTB;&&&&// 96KHz*pPCG_CTLB0 =&&FSB_DIVIDER | ENFSB | ENCLKB ;我是OP...
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Copyright © 2010 . All rights reserved.25430 Call, 1 Queries, Processed in 0.046875 second(s),ADSP-21465W现货库存、热门库存，ADSP-21465W资料详细参数、ADSP-21465WPDF下载 -
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型号：ADSP-21469BBC-3
制造商：Analog Devices Inc
RoHS： 含铅 / 不符合限制有害物质指令(RoHS)规范要求
封装：托盘说明：IC DSP 32/40BIT 400MHZ 324CSPBGA
标准包装：1
类别：集成电路 (IC)
家庭：嵌入式 - DSP（数字式信号处理器）
系列：SHARC?
包装：托盘
类型：浮点
接口：I2C，串行，SMBus
时钟速率：400MHz
非易失性存储器：外部
片载 RAM：5Mb
电压 - I/O：3.30V
电压 - 内核：1.05V
工作温度：-40°C ~ 85°C
安装类型：表面贴装
封装/外壳：324-BGA，CSPBGA
供应商器件封装：324-CSPBGA (19x19)
电话：086-010-66716
地址：北京市海淀区增光路27号院增光佳苑2号楼1单元1102室
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