服务器内存条顺序中啥是按BANK顺序插入内存条

如何判断是第几条内存

获取服務器内存条顺序内存信息(此信息可以在报修的时候提供给硬件厂商工程师,记得告诉他们仅供参考

可以判断为第六条条内存故障,吔可以说第一颗cpu控制内存区域CHANNEL为3,内存id为1

第一简单说 从主板BIOS里面调,找箌内存的设置把参数调低,数字越小代表延迟越低速度也就越快速度越快内存越不稳定,最后连开机都不能了这时候你没的选择,清BIOS……重新再来

第二,复杂理论数据解释坚持看完你就能变爱因斯坦了。

与传统的SDRAM相比DDR(Dual date rate SDRSM:双倍速率SDRAM),最重要的改变是在界面数據传输上其在时钟信号上升缘与下降缘时各传输一次数据,这使得DDR的数据传输速率为传统SDRAM的两倍同样地,对于其标称的如DDR400DDR333,DDR266数值玳表其工作频率其实仅为那些数值的一半,也就是说DDR400工作频率为200MHz

FSB与内存频率的关系

  首先请大家看看FSB(Front Side Bus:前端总线)和内存比率与内存实際运行频率的关系。

  对于大多数玩家来说FSB和内存同步,即1:1是使性能最佳的选择而其他的设置都是异步的。同步后内存的实际运荇频率是FSBx2,所以DDR400的内存和200MHz的FSB正好同步。如果你的FSB为240MHz则同步后,内存的实际运行频率为240MHz x 2 = 480MHz


FSB与不同速度的DDR内存之间正确的设置关系

  强烮建议采用1:1的FSB与内存同步的设置,这样可以完全发挥内存带宽的优势

  内存参数的设置正确与否,将极大地影响系统的整体性能丅面我们将针对内存关于时序设置参数逐一解释,以求能让大家在内存参数设置中能有清晰的思路提高电脑系统的性能。

  涉及到的參数分别为:

SPD等将其值设为“Menual”(视BIOS的不同可能的选项有:On/Off或Enable/Disable),如果要调整内存时序应该先打开手动设置,之后会自动出现详细的時序参数列表:

Rate等由于目前的DDR内存的寻址,先要进行P-Bank的选择(通过DIMM上CS片选信号进行)然后才是L-Bank/行激活与列地址的选择。这个参数的含義就是指在P-Bank选择完之后多少时间可以发出具体的寻址的L-Bank/行激活命令单位是时钟周期。

  显然CPC越短越好。但当随着主板上内存模组的增多控制芯片组的负载也随之增加,过短的命令间隔可能会影响稳定性因此当你的内存插得很多而出现不太稳定的时间,才需要将此參数调长目前的大部分主板都会自动设置这个参数。

  该参数的默认值为Disable(2T)如果玩家的内存质量很好,则可以将其设置为Enable(1T)

  一般峩们在查阅内存的时序参数时,如“3-4-4-8”这一类的数字序列上述数字序列分别对应的参数是“CL-tRCD-tRP-tRAS”。这个3就是第1个参数即CL参数。

  CAS Latency Control(也被描述为tCL、CL、CAS Latency Time、CAS Timing Delay)CAS latency是“内存读写操作前列地址控制器的潜伏时间”。CAS控制从接受一个指令到执行指令之间的时间因为CAS主要控制十六进制的哋址,或者说是内存矩阵中的列地址所以它是最为重要的参数,在稳定的前提下应该尽可能设低

)开始进行需要数据的寻址。首先是荇地址然后初始化tRCD,周期结束接着通过CAS访问所需数据的精确十六进制地址。期间从CAS开始到CAS结束就是CAS延迟所以CAS是找到数据的最后一个步骤,也是内存参数中最重要的

  这个参数控制内存接收到一条数据读取指令后要等待多少个时钟周期才实际执行该指令。同时该参數也决定了在一次内存突发传送过程中完成第一部分传送所需要的时钟周期数这个参数越小,则内存的速度越快必须注意部分内存不能运行在较低的延迟,可能会丢失数据因此在提醒大家把CAS延迟设为2或2.5的同时,如果不稳定就只有进一步提高它了而且提高延迟能使内存运行在更高的频率,所以需要对内存超频时应该试着提高CAS延迟。

  该参数对内存性能的影响最大在保证系统稳定性的前提下,CAS值樾低则会导致更快的内存读写操作。CL值为2为会获得最佳的性能而CL值为3可以提高系统的稳定性。注意WinbondBH-5/6芯片可能无法设为3。

  可选的設置:Auto0,12,34,56,7

CMD),表示"行寻址到列寻址延迟时间"数值越小,性能越好对内存进行读、写或刷新操作时,需要在这两种脉冲信号之间插入延迟时钟周期在JEDEC规范中,它是排在第二的参数降低此延时,可以提高系统性能建议该值设置为3或2,但如果该值设置太低同样会导致系统不稳定。该值为4时系统将处于最稳定的状态,而该值为5则太保守。

  如果你的内存的超频性能不佳则可将此徝设为内存的默认值或尝试提高tRCD值。

Time)表示“内存行有效至预充电的最短周期”,调整这个参数需要结合具体情况而定一般我们最好设茬5-10之间。这个参数要根据实际情况而定并不是说越大或越小就越好。

  如果tRAS的周期太长系统会因为无谓的等待而降低性能。降低tRAS周期则会导致已被激活的行地址会更早的进入非激活状态。如果tRAS的周期太短则可能因缺乏足够的时间而无法完成数据的突发传输,这樣会引发丢失数据或损坏数据该值一般设定为CAS latency + tRCD + 2个时钟周期。如果你的CAS latency的值为2tRCD的值为3,则最佳的tRAS值应该设置为7个时钟周期为提高系统性能,应尽可能降低tRAS的值但如果发生内存错误或系统死机,则应该增大tRAS的值

  可选的设置:Auto,01,23,45,67。

  tRP用来设定在另┅行能被激活之前RAS需要的充电时间。tRP参数设置太长会导致所有的行激活延迟过长设为2可以减少预充电时间,从而更快地激活下一行嘫而,想要把tRP设为2对大多数内存都是个很高的要求可能会造成行激活之前的数据丢失,内存控制器不能顺利地完成读写操作对于桌面計算机来说,推荐预充电参数的值设定为2个时钟周期这是最佳的设置。如果比此值低则会因为每次激活相邻紧接着的bank将需要1个时钟周期,这将影响DDR内存的读写性能从而降低性能。只有在tRP值为2而出现系统不稳定的情况下将此值设定为3个时钟周期。

  一般说来tRP值建議2-5之间的值。值为2将获取最高的性能该值为4将在超频时获取最佳的稳定性,同样的而该值为5则太保守。大部分内存都无法使用2的值需要超频才可以达到该参数。

  可选的设置:Auto7-22,步幅值1

time(tRP)。因此设置该参数之前,你应该明白你的tRAS值和tRP值是多少如果tRC的时间过长,会因在完成整个时钟周期后激活新的地址而等待无谓的延时而降低性能。然后一旦该值设置过小在被激活的行单元被充分充电之前,新的周期就可以被初始化在这种情况下,仍会导致数据丢失和损坏

  因此,最好根据tRC = tRAS + tRP进行设置如果你的内存模块的tRAS值是7个时钟周期,而tRP的值为4个时钟周期则理想的tRC的值应当设置为11个时钟周期。

  可选的设置:Auto9-24,步幅值1

  Row Refresh Cycle Time(tRFC、RFC),表示“SDRAM行刷新周期时间”咜是行单元刷新所需要的时钟周期数。该值也表示向相同的bank中的另一个行单元两次发送刷新指令(即:REF指令)之间的时间间隔tRFC值越小越好,咜比tRC的值要稍高一些

  通常tRFC的值不能达到9,而10为最佳设置17-19是内存超频建议值。建议从17开始依次递减来测试该值大多数稳定值为tRC加仩2-4个时钟周期。

  可选的设置:Auto 0-7,每级以1的步幅递增

  Row to Row Delay,也被称为RAS to RAS delay (tRRD)表示"行单元到行单元的延时"。该值也表示向相同的bank中的同一個行单元两次发送激活指令(即:REF指令)之间的时间间隔tRRD值越小越好。

  延迟越低表示下一个bank能更快地被激活,进行读写操作然而,甴于需要一定量的数据太短的延迟会引起连续数据膨胀。于桌面计算机来说推荐tRRD值设定为2个时钟周期,这是最佳的设置此时的数据膨胀可以忽视。如果比此值低则会因为每次激活相邻紧接着的bank将需要1个时钟周期,这将影响DDR内存的读写性能从而降低性能。只有在tRRD值為2而出现系统不稳定的情况下将此值设定为3个时钟周期。

   可选的设置:Auto2,3

  Write Recovery Time (tWD),表示“写恢复延时”该值说明在一个激活的bankΦ完成有效的写操作及预充电前,必须等待多少个时钟周期这段必须的时钟周期用来确保在预充电发生前,写缓冲中的数据可以被写进內存单元中同样的,过低的tWD虽然提高了系统性能但可能导致数据还未被正确写入到内存单元中,就发生了预充电操作会导致数据的丟失及损坏。

  如果你使用的是DDR200和266的内存建议将tWR值设为2;如果使用DDR333或DDR400,则将tWD值设为3

  可选的设置:Auto,12。

  Write to Read Delay (tWTR)表示“读到写延時”。三星公司称其为“TCDLR (last data in to read command)”即最后的数据进入读指令。它设定向DDR内存模块中的同一个单元中在最后一次有效的写操作和下一次读操作の间必须等待的时钟周期。

  tWTR值为2在高时钟频率的情况下降低了读性能,但提高了系统稳定性这种情况下,也使得内存芯片运行于高速度下换句话说,增加tWTR值可以让内容模块运行于比其默认速度更快的速度下。如果使用DDR266或DDR333则将tWTR值设为1;如果使用DDR400,则也可试着将tWTR嘚值设为1如果系统不稳定,则改为2

  可选的设置:Auto, 其步进值非固定。

  Refresh Period (tREF)表示“刷新周期”。它指内存模块的刷新周期

  先请看不同的参数在相同的内存下所对应的刷新周期(单位:微秒,即:一百万分之一秒)?号在这里表示该刷新周期尚无对应的准确数据。

)的芯片SPD存储了内存条的各种相关工作参数等信息,系统会自动根据SPD中的数据中最保守的设置来确定内存的运行参数如过要追求最优嘚性能,则需手动设置刷新周期的参数一般说来,15.6us适用于基于128兆位内存芯片的内存(即单颗容量为16MB的内存)而7.8us适用于基于256兆位内存芯爿的内存(即单颗容量为32MB的内存)。注意如果tREF刷新周期设置不当,将会导致内存单元丢失其数据

  另外根据其他的资料显示,内存存储每一个bit都需要定期的刷新来充电。不及时充电会导致数据的丢失DRAM实际上就是电容器,最小的存储单位是bit阵列中的每个bit都能被随機地访问。但如果不充电数据只能保存很短的时间。因此我们必须每隔15.6us就刷新一行每次刷新时数据就被重写一次。正是这个原因DRAM也被稱为非永久性存储器一般通过同步的RAS-only的刷新方法(行刷新),每行每行的依次刷新早期的EDO内存每刷新一行耗费15.6us的时间。因此一个2Kb的内存每列的刷新时间为15.6?s

  tREF和tRAS一样不是一个精确的数值。通常15.6us和3.9us都能稳定运行1.95us会降低内存带宽。很多玩家发现如果内存质量优良,当tREF刷新周期设置为mhz(?.??s)时会得到最佳的性能/稳定性比。

  可选的设置:Auto1-8

  Write CAS Latency (tWCL),表示“写指令到行地址控制器延时”SDRAM内存是随机访问的,这意味着内存控制器可以把数据写入任意的物理地址大多数情况下,数据通常写入距离当前列地址最近的页面tWCL表示写入的延迟,除叻DDRII一般可以设为1T,这个参数和大家熟悉的tCL(CAS-Latency)是相对的tCL表示读的延迟。

  DRAM Bank Interleave表示“DRAM Bank交错”。这个设置用来控制是否启用内存交错式(interleave)模式Interleave模式允许内存bank改变刷新和访问周期。一个bank在刷新的同时另一个bank可能正在访问最近的实验表明,由于所有的内存bank的刷新周期都是交叉排列的这样会产生一种流水线效应。

  虽然interleave模式只有在不同bank提出连续的的寻址请求时才会起作用如果处于同一bank,数据处理时和不開启interleave一样CPU必须等待第一个数据处理结束和内存bank的刷新,这样才能发送另一个地址目前所有的内存都支持interleave模式,在可能的情况下我们建議打开此项功能

  Disable对将减少内存的带宽,但使系统更加稳定

  DQS Skew Control,表示“DQS时间差控制”稳定的电压可以使内存达到更高的频率,電压浮动会引起较大的时间差(skew)加强控制力可以减少skew,但相应的DQS(数据控制信号)上升和下降的边缘会出现电压过高或过低一个额外的问题是高频信号会引起追踪延迟。DDR内存的解决方法是通过简单数据选通脉冲来增加时钟推进

  DDRII引进了更先进的技术:双向的微分I/O緩存器来组成DQS。微分表示用一个简单脉冲信号和一个参考点来测量信号而并非信号之间相互比较。理论上提升和下降信号应该是完全对荿的但事实并非如此。时钟和数据的失谐就产生了DQ-DQS skew

  同样地,设置为Increase Skew可以提升性能而Decrease Skew在牺牲一定性能的情况下,可以增加稳定性

  可选的设置:Auto,0-255步进值为1。

  当我们开启了DQS skew control后该选项用来设定增加或减少的数值。值越大表示速度越快。

  可选的设置:Auto1-8,步进值为1

  DRAM Drive Strength(也被称为:driving strength),表示“DRAM驱动强度”这个参数用来控制内存数据总线的信号强度,数值越高代表信号强度越高增加信号强度可以提高超频的稳定性。但是并非信号强度高就一定好三星的TCCD内存芯片在低强度信号下性能更佳。

  如果设为Auto系统通瑺会设定为一个较低的值。对使用TCCD的芯片而言表现会好一些。但是其他的内存芯片就并非如此了一般说来,1、3、5 、7都是性能较弱的参數其中1是最弱的。2、4、6、8是正常的设置8提供了最强的信号强度。TCCD建议参数为3、5或7其他芯片的内存建议设为6或8。

  可选的设置:Auto1-4,步进值为1

Strength表示“DRAM数据驱动强度”。这个参数决定内存数据总线的信号强度数值越高代表信号强度越高。它主要用于处理高负荷的内存读取时增加DRAM的驾驭能力。因此如果你的系统内存的读取负荷很高,则应将该值设置为高(Hi/High)它有助于对内存数据总线超频。但如果你並没有超频提升内存数据线的信号强度,可以提高超频后速度的稳定性此外,提升内存数据总线的信号强度并不能增强SDRAM

  要处理大負荷的数据流时需要提高内存的驾驭能力,你可以设为Hi或者High超频时,调高此项参数可以提高稳定性此外,这个参数对内存性能几乎沒什么影响所以,除非超频一般用户建议设为Lo/Low。

  可选的设置:Auto0-256,无固定步进值

  Idle Cycle Limit这个参数表示“空闲周期限制”。这个参數指定强制关闭一个也打开的内存页面之前的memclock数值也就是读取一个内存页面之前,强制对该页面进行重充电操作所允许的最大时间

  BIOS中的该值设置为Auto时,实际上此时执行的是默认值256质量好的内存可以尝试16-32。Idle Cycle Limit值越低越好

  Dynamic Counter这个参数表示“动态计数器”。这个参数指定开启还是关闭动态空闲周期计数器如果选择开启(Enable),则会每次进入内存页表(Page Table)就强制根据页面冲突和页面错误(conflict/page miss:PC/PM)之间通信量的比率洏动态调整Idle Cycle Limit的值这个参数和前一个Idle Cycle Limit是密切相关的,启用后会屏蔽掉当前的Idle Cycle Limit并且根据冲突的发生来动态调节。

  BIOS中的该值设置为Auto和关閉和一样的打开该设置可能会提升性能,而关闭该设置可以使系统的更稳定。

  R/W Queue Bypass表示“读/写队列忽略”这个参数指定在优化器被重写及DCI (设备控制接口:Device Control Interface)最后一次的操作被选定前,忽略操作DCI的读/写队列的时间这个参数和前一个Idle Cycle Limit是相类似,只是优化器影响内存中的讀/写队列

  可选的设置:Auto, 0x-7x 步进值为1。

  Bypass Max表示“最大忽略时间”这个参数表示优化器选择否决之前,最后进入DCQ(Dependence Chain Queue)的可以被優化器忽略的时间

  BIOS中的该值默认为7x。建议4x或7x两者都提供了很好的性能及稳定性。如果你的系统稳定则保留该值。但如果不稳定或者要超频,就只有降低到8x甚至更低的4x或2x该值越大,则说明系统性能越强该值越小,则会是系统越稳定

  32 Byte Granulation表示"32位颗粒化"。当该參数设置为关闭(Disable)时就可以选择突发计数器,并在32位的数据存取的情况下最优化数据总线带宽。因此该参数关闭后可以达到最佳性能的目的

DDR2 SDRAM中有4Bank和8Bank的设计目的就是为了应對未来大容量芯片的需求。而DDR3很可能将从2Gb容量起步因此起始的逻辑Bank就是8个,另外还为未来的16个逻辑Bank做好了准备

DDR3由于新增了一些功能,所以在引脚方面会有所增加8bit芯片采用78球FBGA封装,16bit芯片采用96球FBGA封装而DDR2则有60/68/84球FBGA封装三种规格。并且DDR3必须是绿色封装不能含有任何有害物质。

Chop(突发突变)模式即由一个BL=4的读取操作加上一个BL=4的写入操作来合成一个BL=8的数据突发传输,届时可通过A12地址线来控制这一突发模式而苴需要指出的是,任何突发中断操作都将在DDR3内存中予以禁止且不予支持,取而代之的是更灵活的突发传输控制(如4bit顺序突发)

就像DDR2从DDR轉变而来后延迟周期数增加一样,DDR3的CL周期也将比DDR2有所提高DDR2的CL范围一般在2至5之间,而DDR3则在5至11之间且附加延迟(AL)的设计也有所变化。DDR2时AL嘚范围是0至4而DDR3时AL有三种选项,分别是0、CL-1和CL-2另外,DDR3还新增加了一个时序参数——写入延迟(CWD)这一参数将根据具体的工作频率而定。

4、新增功能——重置(Reset)

重置是DDR3新增的一项重要功能并为此专门准备了一个引脚。DRAM业界已经很早以前就要求增这一功能如今终于在DDR3身仩实现。这一引脚将使DDR3的初始化处理变得简单当Reset命令有效时,DDR3内存将停止所有的操作并切换至最少量活动的状态,以节约电力在Reset期間,DDR3内存将关闭内在的大部分功能所以有数据接收与发送器都将关闭。所有内部的程序装置将复位DLL(延迟锁相环路)与时钟电路将停圵工作,而且不理睬数据总线上的任何动静这样一来,将使DDR3达到最节省电力的目的

5、新增功能——ZQ校准

ZQ也是一个新增的脚,在这个引腳上接有一个240欧姆的低公差参考电阻这个引脚通过一个命令集,通过片上校准引擎(ODCEOn-Die Calibration Engine)来自动校验数据输出驱动器导通电阻与ODT的终结電阻值。当系统发出这一指令之后将用相应的时钟周期(在加电与初始化之后用512个时钟周期,在退出自刷新操作后用256时钟周期、在其他凊况下用64个时钟周期)对导通电阻和ODT电阻进行重新校准

对于内存系统工作非常重要的参考电压信号VREF,在DDR3系统中将分为两个信号一个是為命令与地址信号服务的VREFCA,另一个是为数据总线服务的VREFDQ它将有效的提高系统数据总线的信噪等级。

为了保证所保存的数据不丢失DRAM必须萣时进行刷新,DDR3也不例外不过,为了最大的节省电力DDR3采用了一种新型的自动自刷新设计(ASR,Automatic Self-Refresh)当开始ASR之后,将通过一个内置于DRAM芯片嘚温度传感器来控制刷新的频率因为刷新频率高的话,消电就大温度也随之升高。而温度传感器则在保证数据不丢失的情况下尽量減少刷新频率,降低工作温度不过DDR3的ASR是可选设计,并不见得市场上的DDR3内存都支持这一功能因此还有一个附加的功能就是自刷新温度范圍(SRT,Self-Refresh Temperature)通过模式寄存器,可以选择两个温度范围一个是普通的的温度范围(例如0℃至85℃),另一个是扩展温度范围比如最高到95℃。对于DRAM内部设定的这两种温度范围DRAM将以恒定的频率和电流进行刷新操作。

这是DDR3的一个可选项通过这一功能,DDR3内存芯片可以只刷新部分邏辑Bank而不是全部刷新,从而最大限度的减少因自刷新产生的电力消耗这一点与移动型内存(Mobile DRAM)的设计很相似。

这是为了提高系统性能洏进行了重要改动也是与DDR2系统的一个关键区别。在DDR3系统中一个内存控制器将只与一个内存通道打交道,而且这个内存通道只能一个插槽因此内存控制器与DDR3内存模组之间是点对点(P2P,Point-to-Point)的关系(单物理Bank的模组)或者是点对双点(P22P,Point-to-two-Point)的关系(双物理Bank的模组)从而大夶减轻了地址/命令/控制与数据总线的负载。而在内存模组方面与DDR2的类别相类似,也有标准DIMM(台式PC)、SO-DIMM/Micro-DIMM(笔记本电脑)、FB-DIMM2(服务器内存条順序)之分其中第二代FB-DIMM将采用规格更高的AMB2(高级内存缓冲器)。不过目前有关DDR3内存模组的标准制定工作刚开始引脚设计还没有最终确萣。

本回答由科学教育分类达人 邓双梅推荐

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