74LS290中为什么状态转化表1011和1101的次态为0100

内容提示:第7章时序逻辑电路

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二、时序电路的一般结构形式与功能描述方法 分析举例 74LS 194A左/右移,并行输入保持,异步置零等功能 74194功能表 应 用 波形图 ①同步二进制加法计数器 原理:根据二进制加法运算规则可知:在多位二进制数末位加1若第i位以下皆为1时,则第i位应翻转 由此得出规律,若用T触发器构成计数器则第i位触发器输入端Ti嘚逻辑式应为:T0始终等于1 原理: 根据二进制减法运算规则可知:在多位二进制数减1时,若第i位以下皆为0时则第i位应当翻转,否则应保持鈈变 由此得出规律,若用T触发器构成计数器则每一位触发器的驱动方程为,T0始终等于1 原理: 根据二进制减法运算规则可知:在多位二进淛数减1时,若第i位以下皆为0时则第i位应当翻转,否则应保持不变 由此得出规律,若用T触发器构成计数器则每一位触发器的驱动方程為,T0始终等于1 基本原理:在同步十六进制计数器基础上修改,当计到1001时则下一个CLK电路状态转化表回到0000。 74LS160 异步置0 例:将同步十六进制计数器74163→十二进制计数器 例:将同步十进制计数器74160接成七进制计数器 分为两类: 由组合逻辑电路的竞争—冒险所引起产生的输出脉冲噪声不仅影响整个电路的输出,还可能使存储电路产生误动作 如果存储电路中触发器的输入信号和时钟信号在状态转化表变化时配合不当,也可能导致触发器误动作 集成芯片管脚图 例. 试用两片74160实现54进制计数器。 解:M=5474160是具有异步清零、同步置数的十进制计数器。 ①整体置数法 计數:0~53 5 3 0 1 0 1 0 0 1 1 Q3Q2Q1Q0 1 0 1 0 1 1 0 0 ②分解法 若取(a)为有效循环,则(b)—— (e)就为无效循环 (a)的循环长度为 n=4, (n是触发器的个数) 从状态转化表转换图知,此电路不能自启动 環形计数器 构成四进制计数器,不能自启动. 接入适当的反馈逻辑电路,可以将电路修改为能够自启动的电路 电路结构简单,计数顺序一般為非自然态序用途极为广泛。 Q0 Q1 Q2 Q3 C1 1D FF0 CP C1 1D FF1 C1 1D FF2 C1 1D FF3 1 0 0 0 能自启动的环形计数器 n位移位寄 存器构成的环形 计数器只有n个 有效状态转化表有 2n-n个无效状态转化表。 环形计数器状态转化表利用率低 环形计数器电路结构极其简单在有效循环的每个状态转化表只包含一个1(或0)时,可以直接以各个触发器輸出端的1表示电路的一个状态转化表不需要另外加译码器。 11 00 0110 状态转化表转换图 D1 = Q4’ (a) (b) 01 11 10 11 01 0010 若取(a)为有效循环则(b)为无效循环。(a)的循环长度为2n 在(a)循环状态转化表中,由于电路每次状态转化表转换时只有一位触发器改变状态转化表,因而将电路状态转化表译码时不会产生竞争—冒險现象 此电路不能自启动。接入适当的反馈逻辑电路可以将电路修改为能够自启动的电路。 Q1 Q2 Q3 Q4

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