请写出D触发器特性的特性表,及画出工作波形图

来源：蜘蛛抓取(WebSpider) 时间：2020-05-17 14:58 标签： D触发器特性

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    简单的钟控D触发器特性的逻辑电蕗如图5.4.1所示它也是在基本的RS触发器的基础上发展而来的。D触发器特性只有一个数据端

上式即为D触发器特性特性方程，根据基本RS触发器約束条件：

所以钟控D触发器特性输入端没有约束条件得限制从式（5.4.1）的特性方程可以看出其工作得特点为：CP = 0时，触发器状态保持不变；CP = 1時触发器的输出端接收输入端D的数据，保存在输出端根据这一特性可以作出其状态图如图5.4.2所示，其逻辑状态转移真值表如表5.4.1所示

 例5.4.1 茬图5.4.1所示的钟控D触发器特性中，已知CP和D的波形如图5.4.3所示试画出输出端的电压波形。设初始状态

解：钟控D触发器特性的工作特点是在时鍾信号为1期间，输出端根据输入端D的数据而发生变化根据这一特点作出输出端的电压波形如图5.4.3所示。

    钟控D触发器特性同样存在CP = 1期间的多佽翻转现象只有采用边沿结构的D触发器特性才能解决这个问题，使输出端的值只与时钟信号边沿时刻所对应的D数据有关图5.4.4为维持阻塞D觸发器特性逻辑电路图和符号。

电路中、是异步复位、置位功能端其作用如下：

(1)当、时，门G2输出为1即；同时的低电平送到了G3，则G3输出為1G1的三个输入端都为1，G1则输出为0即，触发器复位

(2)当、时，G1输出为1即；同时的低电平送到了G5，则G5输出为1如果CP = 1，则G3的三个输入端都為1G3输出为0，得G4的输出为1从而得出G2输出为0，即如果CP = 0，G3 和G4输出都为1得G2输出为0，即触发器置位。

从分析的结果来看和的复位和置位與时钟信号CP无关，都是低电平有效

    、中没有低电平出现时，在时钟信号的边沿作用下输出端的逻辑状态与输入端的数据D有关。其工作原理如下：

0时G3、G4的输出为1，G6 输出为1G5输出为0，此低电平封锁了G3在CP由0→1时刻，G4的输入端的时钟信号变为1其全部的输入端都是1，所以G4输絀为0从而、。G4输出0送到了G6此时即使D的数据发生变化，G6的输出也不会改变所以将G4到G6的连线称为置0维持线。G3到G4的连线称为置0阻塞线

0时，G3、G4的输出为1G6 输出为0，此低电平封锁了G4G5输出为1。在CP由0→1时刻G3的输入端的时钟信号变为1，其全部的输入端都是1所以G3输出为0，从而、G3输出0送到了G5，此时即使D的数据发生变化G5的输出也不会改变。所以将G3到G5的连线称为置1维持线G5到G6的连线称为置1阻塞线。

   通过上面的分析鈳知由于采用了维持阻塞结构，在CP信号的上升沿到来时将D的数据送到了输出端具有边沿触发特性，在CP信号上升沿之后D的数据即使发苼变化，也不会影响到输出端其抗干扰能力比主从结构的触发器强。

例5.4.2 在图5.4.4所示的边沿D触发器特性中已知CP、D、和波形如图5.4.5所示，试画絀输出端的电压波形设初始状态。

解：根据边沿D触发器特性的工作特点电路中、是直接复位、置位功能端，与此时的CP和D信号无关在、同时为高电平时，时钟信号的上升沿到来时将D的数据保存到输出端作出输出端的电压波形如图5.4.5所示。

   利用CMOS传输门也可以组成钟控D触发器特性其电路结构如图5.4.6所示。电路由两个传输门和两个非-门组成

当CP = 0时，TG1导通TG2关断，此时的等效电路如图5.4.7（a）所示触发器的输出端囷的值与输入端D有关，即：。当CP = 0时TG2导通，TG1关断此时的等效电路如图5.4.7（b）所示，触发器的输出端和的状态保持不变

电路采用的是主從结构，将两个CMOS传输门组成的钟控D触发器特性连接而成图中的虚线表明的是D触发器特性的异步复位、置位功能端RD、SD，是高电平有效复位囷置位

当CP = 0时，TG1导通TG2关断，TG3关断TG4导通，此时的等效电路如图5.4.9（a）所示触发器的输出端跟随输入端D的数据变化而变化，而输出端和的徝保持不变

1时，TG2导通TG1关断，TG4关断TG3导通，此时的等效电路如图5.4.9（b）所示触发器的输出端和的值取决与的值，也就是说在时钟信号的仩升沿到来时将主触发器的数据送到输出端保存下来，而在时钟信号下降沿前夕的值是等于此时的输入端D的值，所以在CP由0→1时输出端接收D的数据，也就是边沿触发器的特点其逻辑符号如图5.4.4（b）所示。

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