刚开始接触BIOS开发，目前正在学习关于PCI总线方面的知识，以下是本人根据网上的资料所整理的PCI学习笔记，如果有什么不对的地方，感谢大神的斧正。
众所周知，PCI总线是计算机主板上不可或缺的部分，它连接着大部分的硬件设备，可以连接扩展到Super I/O上连接键盘和鼠标等低速设备，也可以连接声卡、网卡等中高速设备，甚至可以扩展PCIe总线连接显卡这类高速设备。
一、 PCI总线
1、PCI总线简介
PCI是PeripheralComponent Interconnect（）的缩写，它是一种局部并行总线标准。它的工作频率是33MHz，PCI总线是一种树型结构，并且独立于CPU总线，可以和CPU总线并行操作。PCI总线上可以挂接PCI设备和PCI桥片，PCI总线上只允许有一个PCI主设备，其他的均为PCI
从设备，而且读写操作只能在主从设备之间进行，从设备之间的数据交换需要通过主设备中转。
2、PCI总线主要性能
（1）传输速率高。在32bit操作系统中最大传输为132MB/s，在64bit操作系统中传输速率可达到264MB/s。
（2）能够多总线共存。在一个系统中可容纳多种总线设备共同工作，允许不同速度的设备一同工作。
（3）独立于CPU。PCI总线不依赖于某一具体的CPU。
（4）自动识别与配置外设。用户使用方便。
（5）并行操作能力。一种并行的数据传输方式，传输效率高。
（6）适应不同的电压环境。可以在5V和3.3V电压下工作。
3、PCI总线特点
（1）高速性。PCI总线的主设备（Master）可与微机内存直接交换数据，而不必经过微机CPU中转，也提高了数据传送的效率。
（2）即插即用性。而PCI的硬件资源则是由微机根据其各自的要求统一分配，决不会有任何的冲突问题。
（3）可靠性。PCI总线增加了奇偶校验错（PERR）、系统错（SERR）、从设备结束（STOP）等控制信号及超时处理等可靠性措施，使数据传输的可靠性大为增加。
（4）复杂性。硬件设计和软件开发上的难度增加。
（5）自动配置。PCI中有256字节的空间存放配置信息（中断、存储地址和某些定时信息）。
（6）中断共享。低电平触发方式，多个中断可使用同一中断。
（7）扩展性好。可以多级采用PCI总线进行扩展，都是并发工作。
（8）多路复用。采用了和数据线共用一组物理线路
（9）严格规范。PCI总线对协议、时序、电气性能、机械性能等指标都有严格的规定，保证其可靠性和兼容性。
二、 PCI协议基础
1、 PCI设备引脚介绍
图1 PCI总线引脚图
按照类型将上述引脚分类，逐个进行介绍。
（1）、系统信号线
CLK：时钟信号线，系统在时钟信号上升沿是有效，才能进行传输。
RST：复位信号线，在低电平时信号才能进行传输。
（2）、地址及数据线
AD0-AD31：地址和数据多路复用的输入输出信号。在FRAME有效时是地址周期，在IRDY和TRDY同时有效时是数据周期。在执行地址周期时，地址周期为一个时钟周期，在该周期中AD0～AD31线上含有一个32位的物理地址，对于I／O操作，它是一个字节地址；若是存储器操作和配置操作，则是双字地址。在执行数据周期时，IRDY有效表示写数据稳定，TRDY有效表示读数据有效。
C/BE0~3：总线命令和字节使能多路复用信号线。在地址周期内，这四条线上传输的是总线命令；在数据周期内，传输的是字节使能信号，用来表示在整个数据期中， AD0～AD31上哪些字节为有效数据。
PAR：奇偶校验信号。它通过AD[31：：00]和C/BE[3：：0]进行奇偶校验。主设备为地址周期和写数据周期驱动PAR，从设备为读数据周期驱动PAR。
（3）、接口控制信号线
FRAME：帧周期信号。由当前主设备驱动，表示一次访问的开始和持续时间。当其 无效时，表示传输的最后一个数据周期。
IRDY：主设备准备好信号。该信号有效表明发起本次传输的设备（主设备）能够完成一个数据期。它要与TRDY配合使用，当这两者同时有效时，才能进行完整的数据传输，否则即为等待周期。在写周期，该信号有效时，表示有效的数据信号已在AD0～AD31中建立；在读周期，该信号有效时，表示主设备已做好接收数据的准备。
TDRY：从设备准备好信号。该信号有效表示从设备已做好完成当前数据传输的准备工作，此时可进行相应的数据传输。同样，该信号要与IRDY配合使用，这两者同时有效数据才能进行完整传输。在写周期内该信号有效表示从设备已做好了接收数据的准备。在读周期内，该信号有效表示有效数据已被送入AD0～AD31中，同理， TRDY和IRDY中的任何一个无效时都为等待周期，此时不能进行数据的传输。
STOP：停止数据传输信号。从设备发出的信号，表示请求主设备停止发送数据的信号。
LOCK：锁定信号。有PCI总线上发起数据传输的设备控制发出的信号，多个设备在使用PCI总线，但是LOCK指令的控制者只有一个主设备（由GNT信号标识）。当LOCK信号有效时，表示驱动它的设备所进行的操作可能需要多个传输才能完成，如果对某一设备具有可执行的存储器，那么它必须能实现锁定，以便实现主设备对该存储器的完全独占性访问。对于支持锁定的目标设备，必须能提供一个互斥访问块，且该块不能小于16 个字节。连接系统存储器的主桥路也必须使用LOCK信号。
IDSEL：初始化设备选择信号。在参数配置读写传输期间，用作片选信号。
DEVSEL：设备选择信号。由从设备驱动，该信号有效时，表示驱动它的设备已成为当前访问的从设备。它有效表明总线上的某一设备已被选中。
（4）、仲裁信号线
REQ：总线请求信号。该信号一旦有效即表示驱动它的设备要求使用总线。它是一个点到点的信号线，任何主设备都应有自己的REQ信号。
GNT：总线允许信号。用来向申请占用总线的设备表示其请求已获批准。这也是一 个点到点的信号线，任何主设备都应有自己的GNT信号。
（5）、错误报告信号线
PERR：数据奇偶校验错误报告信号。但是该信号不报告特殊周期中的数据奇偶错误。一个设备只有在响应设备选择信号DEVSEL和完成数据期之后，才能报告一个PERR。对于每个数据接收设备，如果发现数据有错误，就应在数据收到后的两个时钟周期将PERR激活。该信号的持续时间与数据期的多少有关，如果是一个数据期，则最小持续时间为一 个时钟周期；若是一连串的数据期并且每个数据期都有错，那么PERR的持续时间将多于一个时钟周期。由于该信号是持续的三态信号，所以该信号在释放前必须先驱动为高电平。另外，对数据奇偶错的报告不能丢失也不能推迟，需要实时进行响应。
SERR：系统错误报告信号。该信号用于报告地址奇偶错，特殊命令序列中的数据奇偶错，以及其他可能引起灾难性后果的系统错误。 SERR是漏极开路信号，由返遣错误的单元驱动，在一个PCI时钟内有效。SERR信号的发出和时钟同步，因而满足总线上所有其他信号的建立时间和保持时间的要求。
（6）、中断信号线
中断在PCI总线上是可选用的，低电平有效，用漏极开路方式驱动。同时，此类信号的建立和撤销是与时钟不同步的。PCI为每一个单功能设备定义一根中断线。对于多功能设备或连接器，最多可有4条中断线。对于单功能设备，只能使用INTA，其余3条中断线无意义。PCI局部总线有四条中断线，定义如下：
INTA o/d：中断A，用于请求一次中断。
INTB o/d：中断B，用于请求一次中断并只在多功能设备上有意义。
INTC o/d：中断C，功能同中断B。
INTD o/d：中断D，功能同中断B。
多功能设备上的任何一种功能都能连到任何一条中断线上。中断寄存器决定该功能用哪一条中断线去请求中断。如果一个设备只用一条中断线，则这条中断线就称为INTA，如果该设备用了两条中断线，那么它们就称为INTA和INTB，依此类推。对于多功能设备，可以是所有功能用一条中断线，也可以是每种功能有自己的一条中断线，还可以是上两种情况的综合。
系统供应商在对PCI连接器的各个中断信号和中断控制器进行连接时，其方法是随意的，可以是线或方式、程控电子开关方式，或者是二者的组合，这就是说，设备驱动程序对于中断共享事先无法作出任何假定，即它必须能够给任何逻辑设备提供中断。
（7）、高速缓存（Cache）支持信号线
为了使具有可缓存功能的PCI存储器能够和贯穿写（Write-Through）或回写（Write- Back）的Cache相配合工作，可缓存的PCI存储器应该能实现两条高速缓存支持信号作为输入。如果可缓存的存储器位于PCI总线上，那么连接回写式Cache和PCI的桥路必须要利用两条引脚，且作为输出，而连接贯穿写式Cache的桥只需要实现一个信号。上述两个信号的定义如下：
SBO in/out：双向试探返回信号（Snoop Backoff）。当其有效时，说明对某修改行的一次命中，所访问的数据为无效数据。当SBO无效而SDONE有效时，说明PCI发起方正在访问存储器的有效性并可进行高速缓存的操作。
SDONE in/out：监听完成信号（Snoop Done），表明对处理器Cache对主存的监听状态。当其无效时，说明监听仍在进行，否则表示监听已经完成。
（8）、64位总线扩展信号线
AD32～AD63 t/s：扩展的32位地址和数据多路复用线。在地址周期（如果使用了双地址周期DAC命令且REQ64信号有效时）这32条线上含有64位地址的高32位，否则它们是保留的；在数据周期，当REQ64和ACK64同时有效时，这32条线上含有高32位数据。
C/BE 4~7 t/s：总线命令和字节使能多路复用信号线。在数据周期，若REQ64和ACK64同时有效时，该4条线上传输的是表示数据线上哪些字节是有意义的字节使能信号。如C/BE4对应第4个字节，C/BE5对应第5个字节。在地址周期内，如果使用了DAC命令且REQ64信号有效，则表明C/BE 4~7上传输的是总线命令，否则这些位是保留的且不确定。
REQ64：64位传输请求。该信号由当前主设备驱动，表示本设备要求采用64位通路传输数据。它FRAME与有相同的时序。
ACK64：64位传输认可。表明从设备将用64位传输。此信号由从设备驱动，并且和DEVSEL具有相同的时序。
PAR64 t/s：奇偶双字节校验。是AD32～AD63和C/BE 4~7的校验位。当REQ64有效且C/BE 0~3上是DAC命令时，PAR64将在初始地址周期之后一个时钟周期有效，并在DAC命令的第二个地址周期后的一个时钟周期失效。当REQ64和ACK64同时有效时，PAR64在备数据期内稳定有效，并且在IRDY或TRDY发出后的第一个时钟处失效。PAR64信号一旦有效，将保持到数据周期完成之后的一个时钟周期。该信号与AD32～AD63的时序相同，但延迟一个时钟周期。该信号线在任何给定的总线周期内应保证连同AD32～AD63和C/BE
4~7在内的所有信号线上的“1”的个数为偶数（偶校验）或者为奇数（奇校验）。在发送时产生而在接收时进行校验。
2、PCI总线的传输控制
采用猝发成组数据传输的传输方式，一个分组有一个地址相位和一个或多个数据相位组成。数据传输的控制线：
FRAME#：由主设备驱动，说明一次数据传输周期的开始和结束。
IRDY#：由主设备驱动，表示主设备已经作好传送数据的准备。
TRDY#：由从设备驱动，表示从设备已经作好传送数据的准备。
当数据有效时，数据源设备需要无条件设置xRDY#（IRDY/TRDY），接收方可以在适当的时间发出xRDY#（TRDY/IRDY）信号。FRAME#信号有效后的第一个时钟前沿是地址相位的开始，此时，开始传送地址信息和总线命令，下一个时钟前沿进入一个或多个数据相位。每当IRDY#和TRDY#同时有效时，所对应的时钟前沿就使数据在主从设备之间传送。在此期间，可由主设备或从设备分别利用IRDY#和TRDY#的无效而插入等待周期。
只要数据传输已经开始，那么在当前数据相位结束之前，不管是主设备还是从设备都不能撤消命令，必须完成数据传输。最后一次数据传输时(可能紧接地址相位之后)，主设备应撤消FRAME#信号而建立IRDY#，表明主设备已作好了最后一次数据传输的准备。当从设备发出TRDY#信号，表明最后一次数据传输已经完成，接口转入空闲状态，此时FRAME#和IRDY#均被撤消。
对于PCI总线的传输，可总结出以下几条规则：
①FRAME#和IRDY#决定总线的忙／闲状态。当其中一个有效时，表示总线忙；两个都无效时，总线进入空闲状态。
②一旦FRAME#被置为无效，在同一传输期间不能重新置为有效。
③除非设置IRDY#，一般情况下不能设置FRAME#无效(在FRAME#无效后的第一个时钟沿IRDY#必须保持有效)。
④一旦主设备已使IRDY#有效，在当前数据相位完成前，不能改变IRDY#或FRAME#的状态。
⑤在完成最后一个数据相位之后的时钟周期主设备必须使IRDY#无效。
3、PCI总线的寻址
PCI总线定义了三种物理地址空间：内存地址空间、I/O地址空间及配置地址空间，前两种为通常意义的地址空间，第三种配置地址空间用以支持PCI的硬件配置。
PCI总线的地址译码是分散的，每个设备都有自己的地址译码逻辑，从而省去了中央译码逻辑。PCI支持对地址的正向译码和负向译码，所谓正向译码，是指总线上每个设备都监视地址总线上的访问地址，判断是否落在自己的地址范围内，译码速度较快。所谓负向译码，是指要接受未被其他设备在正向译码中接受的所有访问，因此，此种译码方式只能由总线上的一个设备来实现(一般是连接标准扩展总线的桥)。由于它要等到总线上其他所有设备都拒绝之后才能动作，所以速度较慢。负向译码对于标准扩展总线上地址空间零散的设备是很有用的。正向和反向译码设备都不对保留的总线命令发出DEVSEL响应信号。
（1）、I/O地址空间
在I/O地址空间，全部32位AD线都被用来提供一个完整的地址编码（字节地址），使得要求地址精确一级的设备不需多等一个周期就可完成地址译码（产生信号），也使负向地址译码节省了一个时钟在I/O访问中， AD0～AD1这两位很重要，并要与C/BE0～3配合，才能进行一次有效的访问。下表表示了AD[1～0]和初始数据相位中字节允许的有效组合。
表1 字节允许和AD[1～0]的编码
有效的C/BE0～3的组合
XXX0或1111
XX01或1111
X011或1111
（2）、内存地址空间
在存储器访问中，所有的目标设备都要检查AD0～AD1，要么提供所要求的突发传输顺序，或者执行预备断开操作。对于所有支持突发传输的设备都应能实现线性突发性传输顺序，而高速缓存的行切换不一定是存储器地址空间，用AD2～AD31译码得到一个双字地址的访问，而AD[1—0]不参与地址译码，用来指明主设备要求的数据传输顺序。
表2 猝发顺序编码
线性增加方式
保留（在第一个数据相位后解除连接）
Cache行回卷（wrap）模式
保留（在第一个数据相位后解除连接）
如上表所示，在线性增加模式下，每个数据相位后，地址增加一个双字(即加4，对32位传输)或增加两个双字(即加8，对64位传输)，直到传输结束。对于Cache行回卷(warp)模式，传输可从Cache中任意地址偏移处开始，Cache块的长度是由配置空间中的Cache块大小寄存器定义的。访问过程中每次地址增加一个双字(64位传输中地址增加两个双字)，一直到Cache块的末尾，然后回卷到同一Cache块的开始处，再进行到Cache块的剩余部分被传送完为止。
（3）、配置地址空间
在配置的地址空间中，要用AD2～AD7将访问落实到一个DWORD地址，寻址64个双字寄存器。当一个设备收到配置命令，这条配置命令地址被译码，IDSEL信号成立且AD0AD1为00，设备判断是否寻址自己的配置寄存器，如果是则该设备即被选为访问的目标，若不是就不参与当前的对话。如果译码出来符合某桥路的编号，且AD0AD1为01，则说明配置访问是对该桥后面的设备，即不与桥直接连接的设备。
（4）、字节校正
用字节使能信号C/BE0～3来指出哪些字节带了有意义的数据，在每个数据周期内，可以自由改变字节使能，使之对传输数据的实际含义和有效部分进行界定，这一功能称作字节校正或字节对齐。
（5）、总线的驱动与过渡
为了避免多个设备同时驱动一个信号到PCI总线上而产生竞争，在一个设备驱动到另 一个设备之间设一个过渡期，又称为交换周期。在时序图上，交换期用"→←"来表示。
在每个地址周期和数据周期，所有的AD线都必须被驱动到稳定的状态（数据），即使是在当前数据传涉及到的字节所对应的AD线也不例外。在实际应用中，如果对功耗要求较高时，为尽量减少由于总线上信息所造成的功耗，对当前总线周期中不用的字节与前一周期相同的数据去驱动它们。
4、PCI总线的数据传输过程
PCI采用地址／数据复用技术，每一个PCI总线传送由一个地址相位和一个或多个数据相位组成。地址相位由FRAME#变为有效的时钟周期开始。在地址相位，总线主设备通过C／BE[3～0]#发送总线命令。如果是总线读命令，在地址相位后需要一个交换周期，该周期过后，AD[3l～0]改由从设备驱动，以接纳从设备的数据。对于写操作没有过渡期，直接从地址相位进入数据相位。数据相位的个数取决于要传送的数据个数，一个数据相位至少需要一个PCI时钟周期，在任何一个数据相位都可以插入等待周期。FRAME#从有效变成无效表示当前正处于最后一个数据相位。
总线操作结束有多种方式。在大多数情况下，由从设备和主设备共同撤消准备就绪信号TRDY#和IRDY#。如果从设备不能继续传送，可以设置STOP#信号，表示从设备撤消与总线的连接。所寻址的从设备不存在或者DEVSEL#信号一直为无效状态都可能导致主设备结束当前总线操作，使FRAME#和IRDY#变为无效，回到总线空闲状态。
（1）、总线上的读操作
图2表示PCI总线读操作时序的一个例子，从中可以看出，一旦FRAME#信号有效，地址相位便开始，并在时钟2的上升沿处稳定有效。在地址相位内，AD[31～00]上包含有效地址，C／BE#[3～0]上包含一个有效的总线命令。由于是对数据进行读取，因而要先插入一个等待周期，数据相位是从时钟3的上升沿处开始，AD[31一00]上传送的是数据，C／BE#线上的信息用于指定数据线上哪些字节有效(即哪几个字节是当前要传输的)。需要强调的是，无论是读操作还是后面要讲的写操作，从数据相位的开始一直到传输完成，C／BE#的输出缓冲器(或锁存器)必须始终保持有效状态。 图2中的DEVSEL#信号和TRDY#信号由被地址相位内所发地址选中的从设备提供，但要保证TRDY#在DEVSEL#之后出现，IRDY#信号是发起读操作的主设备根据总线的占用情况发出的。数据的真正传输是在IRDY#和TRDY#同时有效的时钟前沿进行的。当这两个信号之一无效时，就表示需要插入等待周期，此时，不进行数据传输。这说明一个数据相位可以包含一次数据传输和若干个等待周期。图中所示的时钟4、6、8处各进行了一次数据传输，而在时钟3、5、7处插入了等待周期。
在读操作中的地址相位和数据相位之间，AD线上要有一个总线交换周期，这通过从设备强制TRDY#实现，即让TRDY#的发出比地址晚一拍。在交换周期过后且DEVSEL#信号变为有效时，从设备必须驱动AD线。
尽管主设备在时钟7处已知道下一个数据相位是本次传送的最后一个，但由于某种原因它暂时不能完成该次传输(此时IRDY#无效)，所以主设备还不能撤消FRAME#，只有在时钟8处，IRDY#变为有效后，FRAME#信号才能撤消，从而通知从设备这是最后一个数据相位。
图2 PCI总线读操作
（2）、总线上的写操作
图3是PCI总线写操作时序的一个例子。从中可以看出，总线上的写操作与读操作相类似，也是FRAME#的有效表示写操作周期中地址相位的开始，但地址相位后不需要交换周期，因为数据和地址都是由同一主设备提供的。在图3中，第一个和第二个数据相位中没有等待周期，而在第三个数据相位中连续插入了3个等待周期，注意，第一个等待周期是由传输双方共同引起的。告诉从设备最后一个数据相位的方法与读操作时相同，即当FRAME#撤消后，还需要IRDY#处于有效状态。这里，主设备在时钟6处使IRDY#恢复有效，通知从设备这是最后一个数据相位，但由于从设备未准备好，最后一次数据传输到时钟8才完成。
从图中AD和C／BE#的波形可看出，主设备发送数据可以延迟，但字节允许信号不受等待周期的影响，不得延迟发送。
上述的读／写操作均是以多个数据相位为例来说明的。如果是一个数据相位， FRAME#信号在没有等待周期的情况下，应在地址相位(读操作应在交换周期)过后即撤消。对于一个数据相位，中间亦可插入等待周期。
图3 PCI总线写操作
（3）、PCI总线传输的终止过程
无论是主设备还是从设备，都可以提出终止传输的要求，但不一定得到响应。也就是说，主从设备双方均无权单方面终止传输，而需要相互配合，但传输的最终停止控制要由主设备完成。
①由主设备引发的终止
主设备是通过撤消FRAME#并建立IRDY#来提出终止请求的，这样做是为了通知从设备，现在己进入了传输周期中最后一个数据相位。此后，IRDY#一直保持有效直到TRDY#信号有效，完成最后一个数据的传输。接着便撤消IRDY#，从而达到完全终止的条件(FRAME#和IRDY#同时无效)，结束传输，进入总线空闲状态。
主设备一般在下列情况下会提出终止传输：
a一次数据传输即将结束(剩下一个数据未传输)。
b总线上有更高优先级的总线占用请求，而总线仲裁器取消当前主设备的总线控制权(移去了GNT#信号)。
c主设备发出了FRAME#后在规定的时间内没有检测到目标设备的DEVSEL#响应信号。
②由从设备引发的终止
从设备可以通过STOP#信号请求终止传输。一旦STOP#有效，就必须保持有效到主设备置FRAME#无效。IRDY#和TRDY#之间的关系与STOP#和FRAME#之间的关系无关。所以，在从设备请求终止期间数据仍可以传送，这仅取决于当时IRDY#和TRDY#的状态。
从设备可由下面两种原因请求终止传输：
①从设备正处于不能传送数据的状态。例如，设备的数据缓冲器满，暂时不能接收数据，或者因数据缓冲器空而不能发送数据等。待传送条件满足后，重新启动传输。这种情况称为“重入(Retry)”。
②由于从设备的响应速度太慢，在PCI引导时间长度(8个时钟周期)不能作出响应以及在猝发传输中，从设备检测到下一个数据的地址已经超出规定的范围等原因而提出终止传输请求。此种情况称为“解除连接(Disconnect)”。
PCI总线---深入理解PCI总线
8.1 深入理解PCI总线
8.1.1 PCI设备工作原理
8.1.2 PCI总线域
8.1.3 PCI资源管理器
8.1.4 PCI配置空间读取和设置...
PCI协议简析
PCI协议是一套工业标准，这个就不细说了，这套协议有点类型IP协议，由多种不同功能的设备组成，主要是主机，主设备， bridge(桥) ，从设备等等组成， PCI bridge 类似于IP协议里面的 ...
PCI总线原理
PCI即Peripheral Component Interconnect，中文意思是“外围器件互联”，是由PCISIG (PCI Special Interest Group)推出的一种局部并行总线...
PCI 总线学习笔记-PCI9054
转载请注明出处：http://blog.csdn.net/lg2lh/article/details/8042008
PCI的基本协议这里就不介绍了，因为一般的芯片协议都是集成好的，我只需要大体了解就...
PCI总线操作三： PCI总线协议的基础
PCI总线协议的基础
注：看完之后，觉得还要详细研读一下spec。以前的理解可能不深刻。
PCI总线上动作最基本的机制是burst。一个burst由一个地址phase和一个或多个数据phase组成...
&em&PCI&/em&局部总线规范 2 文档约定 2 第1章 简介 3 规范的内容 3 规范的动机 3 &em&PCI&/em&局部总线的应用 3 &em&PCI&/em&局部总线的架构 4 &em&PCI&/em&局部总线的特性和益处 5 第2章 ...
目前市面上的专业的spec,大多数都是英文的,对于英文不太好的大神们来说是个煎熬,通过阅读本书,可以清晰的对&em&pci&/em&的架构还有各种方法机制有个清楚的了解,同时对比...
&em&PCI协议&/em&中文版,对pci总线各个信号的定义以及作用有清晰的解释,中文版的哦... &em&PCI协议&/em&中文版,对pci总线各个信号的定义以及作用有清晰的解释,中文版的哦 ...
PCI总线推出以来，以其独有的特性受到众多厂商的青睐，已经成为计算机扩展总线的主流。目前，国内的许多技术人员已经具备开发PCI总线接口设备的能 力。但是PCI总线的编程技术，也就是对PCI总线设备的操...
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称Universal Serial Bus（通用串行总线），目前USB
2.0接口分为四种类型A型、B型、Mini型还有后来补充的Micro型接口，每种接口都分插头和插座两个部分，Micro还有比较特殊的AB兼容型，
本文简要介绍这四类插头和插座的实物及结构尺寸图，如果是做设计用途，还需要参考官方最新补充或修正说明，尽管性能非常卓越，但由于USB 3.0规范变化较大，真正应用起来还需假以时日，不管怎样，都已经把火线逼到末路，苹果公司极其郁闷但也爱莫能助。
1、本文封装尺寸来源，USB 2.0 Specification Engineering Change Notice（Date:10/20/2000）
2、本文图片来源文档，由于USB 3.0在接口和线缆规范上变化较大，后面专门介绍。
3、本文未带插头封装尺寸，插头尺寸请参加官方文档ecn1-usb20-miniB-revd.pdf，下个版本USB
3.0在接口和封装上都有很大变化，本文属于USB 2.0协议内容，如果是USB
3.0设备，似乎只有A型头才能插到2.0插座中Receptacle。
1、A型USB插头（plug）和A型USB插座（receptacle）
引脚顺序（左侧为Plug，右侧为Receptacle）：
引脚定义：
Red（红色）
White（白色）
Green（绿色）
Black（黑色）
封装尺寸（单PIN Receptacle）：
2、B型USB插头（plug）和B型USB插座（receptacle）
引脚顺序（左侧为Plug，右侧为Receptacle，注意箭头所指斜口向上，USB端口朝向自己）：
引脚定义、封装尺寸均与A型引脚说明相同。
尺寸（单PIN Receptacle）：
3、Mini B型USB插头（plug）和Mini B型USB插座（receptacle）
引脚顺序（左侧为Plug，右侧为Receptacle，注意宽边在上，USB端口朝向自己）：
引脚定义：
Red（红色）
White（白色）
Green（绿色）
Not connected（未连接）
Black（黑色）
尺寸（Receptacle）：
以上部分为USB 2.0规范内容，下面的Micro USB实际上是在2006年才发布的补充规范，由于该接口定义无法后向支持USB 3.0协议，故仍然归于USB 2.0协议包。
4、Micro USB插头和插座
Micro USB补充定义用于蜂窝电话和便携设备的Micro USB接口，比Mini USB接口更小。其中标准A型和标准B型及Mini-B型都是在USB 2.0规范里定义，2006补充的Micro USB规范定义了，补充了以下定义：
Micro-B plug and receptacle
Micro-AB receptacle
Micro-A plug
由于该协议文档极不清晰，相关插图也是采用贴图形式，所以不再抓图介绍，只放两个实物照片上来看一下（图片来源:）：
详细了解，请参考官方USB 2.0规范文档，之Micro-USB_1_01.pdf一文，附USB官方网址：。
USB 3.1 TypeC的引脚定义,工作流程(附图文)
鉴于近期常有客户向我司咨询关于USB 3.1 TypeC的引脚定义及工作流程图解释,广佳源电子特将USB 3.1 TypeC的资料进行整理上传,供客户参阅,详情如下：USB 3.1 Type-C特色:尺寸小，支持正反插，速度快(10Gb)。这个小是针对以前电脑上的USB接口说的，实际相对android机上的microUSB还大了点：USB 3.1 Type-C：8.3mmx2.5mmmicroUSB：7.4mmx2.35mm而lightning：7.5mmx2.5mm所以，从尺寸上我看不到USB Type-C在手持设备上的优势。而速度，只能看视频传输是否需要了。USB 3.1 Type-C引脚定义可以看到，数据传输主要有TX/RX两组差分信号，CC1和CC2是两个关键引脚，作用很多：o 探测连接，区分正反面，区分DFP和UFP，也就是主从o 配置Vbus，有USB Type-C和USB Power Delivery两种模式o 配置Vconn，当线缆里有芯片的时候，一个cc传输信号，一个cc变成供电Vconno 配置其他模式，如接音频配件时，dp，pcie时电源和地都有4个，这就是为什么可以支持到100W的原因。不要看着USB Type-C好像能支持最高20V/5A，实际上这需要USB PD，而支持USB PD需要额外的pd芯片，所以不要以为是USB Type-C接口就可以支持到20V/5A。当然，以后应该会出现集成到一起的芯片。辅助信号sub1和sub2(Side band use)，在特定的一些传输模式时才用。d+和d-是来兼容USB之前的标准的。这里说一下，USB3.0只有一组RX/TX，速度是5Gb，USB Type-C为了保证正反都可以插就用了两组，但实际上数据传输还是只用了一组RX/TX,速度就已经达到10Gb了。如果后面升级协议，两组都传的话就和DisplayPort一样20Gb了。USB 3.1 TypeC工作流程上图DFP (Downstream Facing Port)也就是主，UFP (Upstream Facing Port)为从。除了DFP、UFP，还有个DRP (Dual Role port)，DRP可以做DFP也可以做UFP。当DPR接到UFP，DRP转化为DFP。当DRP接到DFP，DRP转化为UFP。两个DRP接在一起，这时就是任意一方为DFP，另一方为UFP。在DFP的CC pin有上拉电阻Rp，在UFP有下拉电阻Rd。未连接时，DFP的VBUS是无输出的。连接后，CC pin相连，DFP的CC pin会检测到UFP的下拉电阻Rd，说明连接上了，DFP就打开Vbus电源开关，输出电源给UFP。而哪个CC pin(CC1，CC2)检测到下拉电阻就确定接口插入的方向，顺便切换RX/TX。电阻Rd=5.1k，电阻Rp为不确定的值，根据前面的图看到USB Type-C有几种供电模式，靠什么来甄别?就靠Rp的值，Rp的值不一样，CC pin检测到的电压就不一样，然后来控制DFP端执行哪种供电模式。需要注意的是，上图里画了两个CC，实际上在不含芯片的线缆里只有一根cc线。含芯片的线缆也不是两根cc线，而是一根cc，一根Vconn，用来给线缆里的芯片供电(3.3V或5V)，这时就cc端没有下拉电阻Rd，而是下拉电阻Ra，800-1200欧。当CC pin两个都接了下拉电阻&=Ra，DFP进入音频配件模式，左右声道，mic都俱全，如上图。USB Type-C和DisplayPort，PCIEUSB PD是BMC编码的信号，而之前的USB则是FSK，所以存在不兼容，不知道目前市面上有没有能转换的产品。USB PD是在CC pin上传输，PD有个VDM (Vendor defined message)功能，定义了装置端ID，读到支持DP或PCIe的装置，DFP就进入替代(alternate)模式。如果DFP认到device为DP，便切换MUX/Configuration Switch，让Type-C USB3.1信号脚改为传输DP信号。AUX辅助由Type-C的SBU1,SUB2来传。HPD是检测脚，和CC差不多，所以共用。而DP有lane0-3四组差分信号，Type-C有RX/TX1-2也是四组差分信号，所以完全替代没问题。而且在DP协议里的替代模式，可以USB信号和DP信号同时传输，RX/TX1传输USB数据，RX/TX2替换为lane0,1两组数据传输，此时可支持到4k。如果DFP认到device为DP，便切换MUX/Configuration Switch，让Type-C USB3.1信号脚改为传输PCIe信号。同样的，PCIe使用RX/TX2和SBU1,SUB2来传输数据，RX/TX1传输USB数据。这样的好处就是一个接口同时使用两种设备，当然了，转换线就可以做到，不用任何芯片。USB 3.1 Type-C规范制定历程日USB 3.0推出之后，SuperSpeed带来了5Gbps高速传输效能，附加提供5V/0.9A电源。随着传输速率的要求提高，加上也希望能提升供电能力，日USB IF协会（USB Implementers
Forum）正式宣布要推出新的USB 3.0加强版(即USB 3.1)。日宣布正式开始研发SuperSpeed 10Gbps，日USB 3.0 Promoter
Group正式宣布USB 3.1诞生。到了2014年6月份Computex Taipei 2014，ASMedia第一家正式展示原生USB 3.1晶片，实现SuperSpeed+，也就是SuperSpeed 10Gbps速率。总结USB Type-C终结了长期以来USB插来插去的缺陷，节省了人们大量的时间，换一次方向至少2s吧，按全球10亿人每天插拔一次USB，50%概率插错，共耗时277000多小时，约为31年，太恐怖了。一个接口搞定了音视频数据三种，体积还算小。可以预见，以后安卓机可以改为USB Type-C接口了，如果只需要USB2.0的话，只需要重做线缆，不用芯片，成本上完全可以忽略不计。以上资料为广佳源电子提供,仅供参考,更多相关USB 3.1 Type-C产品请来电咨询。
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